A Proven EDA Solutions Provider makes all the difference.

アルデックは、最新の言語標準をサポートする先進の検証手法を提供して、
お客様が、進化を続ける技術を活用しながら発展することをお約束します。

FPGA デザイン

FPGAベンダーサポートシミュレーションおよびデバッグプロジェクト・マネンジメント/統合環境グラフィカル/テキスト・デザインエントリHTML/PDF ドキュメンテーション

プロトタイピング

SoCおよびASICプロトタイピングRTAX/RTSX ネットリスト・コンバータMicrosemi™(Actel)プロトタイピングARM Cortexのサポート

ファンクショナルベリフィケーション

アサーション/ファンクション・カバレッジUVM トランザクション・デバッギングUVM, OVM, VMMOS-VVM™コード・カバレッジリンティング/デザイン解析非同期クロックドメイン検証

要求管理

トレーサビリティチーム・ベースのメソドロジドキュメントおよびレポート変更の影響分析要求の取り込みテスト管理

ハードウェア・エミュレーション・ソリューション

協調エミュレーションUVMシミュレーション・アクセラレーションアクセラレーションのスケーラビリティ検証用IPSoCのパーティショニングエミュレーション・デバッギング

ハイパフォーマンス・コンピューティング(HPC)

大規模HPC組込みHPC

DO-254 コンプライアンス

HDL コーディング基準ツール・アセスメントおよびクオリフィケーションのプロセスFPGA レベルのイン・ターゲット・テストHDL 詳細設計および検証DO-254テンプレートおよびチェックリスト

特殊アプリケーション

レグレッション・マネージャ暗号化DSPとRFの協調シミュレーション

組込システム

モノのインターネット (IoT)自動車ADAS
Aldec to Showcase FPGA Acceleration of Genome Alignment, Motion Detection and Face Detection Algorithms at isFPGA 2017 2月 21 アルデック、新たなパラダイムを作るFPGA/ASICデザインのデザインルール・チェックとクロック・ドメイン・クロッシング検証を統一したプラットフォームを発表 2月 14 アルデック、Spec-TRACERの最新リリースでDO-254準拠テンプレートとチェックリストを提供 2月 01 アルデック、セーフティクリティカルなFPGAデザイン検証用に有限ステートマシン・カバレッジを提供 1月 19 Top Aldec Design and Verification Blog Articles from 2016 12月 07 すべてのニュースを表示
International Symposium on Field-Programmable Gate Arrays (FPGA 2017) 2月 22 - 24 (業界イベント, Monterey, California) VHDL設計/検証トレーニング 2月 23 - 24 (トレーニング, Tokyo, Japan) 2017 Design and Verification Conference (DVCon) 2月 27 - 3月 02 (業界イベント, San Jose, California ) Embedded World 2017 3月 14 - 16 (業界イベント, Nürnberg, Germany) Certification Together International Conference (CTIC) 3月 21 - 23 (業界イベント, Toulouse, France) すべてのイベントを表示
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