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マルチFPGAプロトタイピングにおける パーティショニングの課題   
ASIC/SoCデザインのマルチFPGAによるプロトタイピングは、エミュレーション技術の中で最も高いクロックレートを実現します。しかし、プロトタイピングのためのデザインセットアップは非常に複雑で困難です。このホワイト ペーパーでは、デザインを複数の FPGA にパーティショニングする際の一般的な課題を明らかにし、プロトタイプの品質を向上させ、デザインのセットアップにかかる時間を短縮するソリューションを提供します。
HES-DVM, HES™ Boards, HES-DVM Proto Cloud Edition ホワイトペーパー
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