アルデック、ハードウェア・インザループとQEMUによる検証技法のデモンストレーションをDVCon China 2017で発表

Date: 2017/04/17Type: Release

Shanghai, China – 2017年4月17日 – FPGA/ASICのHDL混合言語シミュレーションとハードウェア・アシステッド・ベリフィケーションのパイオニアである Aldec, Inc. (以下「アルデック」)は、2017年4月19日に中国の上海で開催される DVCon China Conference and Exhibition で、アルデックのハードウェア・インザループによるASICシリコン製造前検証スペクトラムを発表します。

 

アルデックのハードウェア検証製品マネージャ、Krzysztof Szczurのコメント:
「この四半期は、アルデックのR&Dにとっては忙しく、実りの多い時期でした。 DVCon US で発表した新しいHESボードは最大のXilinx® Virtex® UltraScale™ FPGAを搭載しています。アルデックはさらに、QEMUとRiviera-PROのハードウェア・ソフトウェア協調シミュレーション用の QEMU Bridge を開発し、ドイツのEmbedded Worldで発表し、好評を以て迎えられました。ごく自然な流れとして、次にこの2製品をつないでハードウェア・ソフトウェア協調検証環境を作ることになり、ハードウェア・インザループを作ってQEMUとアルデックのHESボードをつなぎました。この新しい成果を上海のDVCon Chinaで発表致します。」

 

QEMUとHES-DVMのハイブリッド協調エミュレーション

信頼できるハードウェア・ソフトウェア協調検証技法は、SoC ASIC の検証やバリデーションにとって非常に貴重です。QEMUはジェネリックでオープンソースのマシンエミュレータで、ARM® Cortex® ファミリなど多くのコンピュータハードウェアアーキテクチャをサポートしています。これをアルデックのエミュレーションプラットフォーム HES-DVM™ と接続することで、SoC ASICデザイン向けのハイブリッド協調エミュレーション環境が完成します。

 

HES-DVMは合成可能なSystemVerilogやVHDLで記述したデザインのどの部分でもエミュレートできます。ほとんどの場合、そういったデザインは社内開発のSoCの内部で独自の機能を実現するためのカスタムデザインです。逆に、汎用プロセッサ(CPU)はサードパーティからハードIPまたはネットリストファイルとして購入し、RTLコードは提供されません。QEMUはそのような標準部品をエミュレートし、組込みファームウェアやソフトウェアのテストを実行します。QEMUがHES-DVMプラットフォームと簡単に接続できるようになったことで、SoC内部のサブシステムをまるごと検証できるようになりました。このアプローチなら、デザインのハードウェアとソフトウェアを含めた全体を徹底的に検証できます。デザインを完成させるのに必要なデバイスドライバやファームウェアの代わりとして、ダミーパッチをあてる必要もありません。

 

UVMシミュレーション・アクセラレーション

アルデックはHDLシミュレーションに33年も取り組み続け、最新のSoCのデザインや検証で不可欠なものについて深い知識を持ち、その専門知識を駆使してUVM, SystemVerilog, OSVVM, VHDL-2008, およびTLM/SystemCをサポートする高性能HDLシミュレータ Riviera-PRO™ を開発しました。Riviera-PROとハードウェア・インザループで、シミュレーションは100桁のレベルで高速化されます。DVCon China で発表するライブデモでは、130倍ものシミュレーション・アクセラレーションをどう実現するか、ネットワーク・オンチップ(NoC)デザインを例にとってお見せします。Riviera-PRO上でトランザクションレベルのUVMテストベンチを実行、それによりこのNoCデザインをアルデックのFPGAボードHES™上で動作させます。

 

アルデックについて

米国ネバダ州ヘンダーソンに本社を置くアルデックは、エレクトロニクス・デザイン検証のインダストリ・リーダです。RTL設計、RTLシミュレータ、ハードウエア・アシステッド・ベリフィケーション、SoC/ASICプロトタイピング、デザインルールチェック、CDC検証、IPコア、要求ライフサイクル管理、DO-254機能検証、組込みソリューションおよび軍事/航空宇宙向けソリューションといったパテントを取得したテクノロジを提供しています。www.aldec.com


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